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4.1 开关代数的公理和定理（下）
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      1.1 绪论：课程介绍
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      [9] 2.5 信息的二进制编码
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      [10] 2.6 格雷码和检错纠错码
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      [11] 3.1 数字系统的逻辑与实现（上）
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      [12] 3.1 数字系统的逻辑与实现（下）
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      [18] 3.4 电压与电流的容限设置（下）
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      [19] 3.5 集成电路的设计规范
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      4.1 开关代数的公理和定理（上）
      [30] 4.1 开关代数的公理和定理（下）
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      4.1 开关代数的公理和定理（下）
      [31] 4.2 正负逻辑、对偶关系、反演关...
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      4.7 定时冒险（上）
      [40] 4.7 定时冒险（下）
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      4.7 定时冒险（下）
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      [44] 【电子科技大学】《数字逻辑设计及应...
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      [47] 5.2.3 运算符（上）
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      [51] 5.2.4.3 结构说明语句（上）
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      5.2.4.3 结构说明语句（上）
      [52] 5.2.4.3 结构说明语句（下）
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      5.2.4.3 结构说明语句（下）
      [53] 5.2.4.4 编译预处理语句
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      [54] 5.3 组合电路设计
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      5.3 组合电路设计
      [55] 5.4 时序电路设计
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      5.4 时序电路设计
      [56] 6.1.1 组合逻辑设计文档标准1
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      6.1.2 组合逻辑设计文档标准2（下）
      [59] 6.2.1 二进制译码器（上）
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      6.2.1 二进制译码器（上）
      [60] 6.2.1 二进制译码器（下）
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      6.2.1 二进制译码器（下）
      [61] 6.2.2 BCD译码器和七段显示...
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      6.2.2 BCD译码器和七段显示译码器
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      6.3 编码器
      [63] 6.4 三态缓冲器
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      6.4 三态缓冲器
      [64] 6.5 多路复用器（上）
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      6.5 多路复用器（上）
      [65] 6.5 多路复用器（下）
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      6.5 多路复用器（下）
      [66] 6.6 多路分配器和奇偶校验电路
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      6.6 多路分配器和奇偶校验电路
      [67] 6.7.1 比较器
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      [68] 6.7.2 中规模比较器
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      6.7.2 中规模比较器
      [69] 6.8 加法器
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      6.8 加法器
      [70] 7.1 时序逻辑电路概述
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      7.1 时序逻辑电路概述
      [71] 7.2 双稳态器件
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      [72] 7.3.1 SR锁存器工作原理
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      7.3.1 SR锁存器工作原理
      [73] 7.3.2 SR锁存器的描述
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      7.3.2 SR锁存器的描述
      [74] 7.4 D锁存器（上）
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      7.4 D锁存器（上）
      [75] 7.4 D锁存器（下）
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      7.4 D锁存器（下）
      [76] 7.5 D触发器
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      7.5 D触发器
      [77] 7.6 其他D触发器
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      [85] 7.12 时钟同步状态机设计2（上...
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      [89] 7.14 状态机时序
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      7.14 状态机时序
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      [92] 8.2 集成锁存器和触发器（下）
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      [93] 8.3 计数器工作原理（上）
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