数字电路与系统设计-模块十 4.4 主从和边沿触发器（1）-网易公开课

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模块十 4.4 主从和边沿触发器（1）

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模块十 4.4 主从和边沿触发器（1）

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[57] 模块十二 5.7 同步时序电路设计...

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[58] 模块十二 5.7 同步时序电路设计...

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模块十二 5.7 同步时序电路设计（2）（上）

[60] 模块十二 5.7 同步时序电路设计...

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[61] 模块十二 5.8 可逆计数器的设计...

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模块十二 5.8 可逆计数器的设计仿真（上）

[62] 模块十二 5.8 可逆计数器的设计...

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模块十二 5.8 可逆计数器的设计仿真（下）

[63] 模块十二 5.9 建立原始状态图或...

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模块十二 5.9 建立原始状态图或状态表（上）

[64] 模块十二 5.9 建立原始状态图或...

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模块十二 5.9 建立原始状态图或状态表（下）

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模块十二 5.10 建立原始状态图或状态表举例（上）

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模块十二 5.10 建立原始状态图或状态表举例（下）

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模块十三 5.12 状态分配（上）

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[69] 模块十三 5.13 同步时序逻辑电...

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模块十三 5.13 同步时序逻辑电路的设计举例（上）

[70] 模块十三 5.13 同步时序逻辑电...

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模块十三 5.13 同步时序逻辑电路的设计举例（下）

[71] 模块十四 5.14 集成计数器（上...

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模块十四 5.14 集成计数器（上）

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[73] 模块十四 5.15 集成计数器级联...

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[74] 模块十四 5.15 集成计数器级联...

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[75] 模块十四 5.16 异步清零法实现...

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[76] 模块十四 5.16 异步清零法实现...

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[77] 模块十五 5.17 同步置数法实现...

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模块十七 5.24 序列信号发生器（上）

[92] 模块十七 5.24 序列信号发生器...

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模块十七 5.24 序列信号发生器（下）