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7.12 时钟同步状态机设计2（上）
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      [1] 1.1 绪论：课程介绍
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      1.1 绪论：课程介绍
      [2] 1.2模拟与数字
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      1.2模拟与数字
      [3] 1.3 数字技术
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      1.3 数字技术
      [4] 2.1 数制转换（上）
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      [5] 2.1 数制转换（下）
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      [6] 2.2 二进制的算术运算
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      [7] 2.3 符号数的表示
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      2.3 符号数的表示
      [8] 2.4 二进制补码的加法和减法
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      2.4 二进制补码的加法和减法
      [9] 2.5 信息的二进制编码
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      2.5 信息的二进制编码
      [10] 2.6 格雷码和检错纠错码
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      [11] 3.1 数字系统的逻辑与实现（上）
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      3.1 数字系统的逻辑与实现（上）
      [12] 3.1 数字系统的逻辑与实现（下）
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      [13] 3.2 开关电路与CMOS结构（上...
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      [14] 3.2 开关电路与CMOS结构（下...
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      [15] 3.3 CMOS结构的扩展（上）
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      [16] 3.3 CMOS结构的扩展（下）
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      [17] 3.4 电压与电流的容限设置（上）
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      3.4 电压与电流的容限设置（上）
      [18] 3.4 电压与电流的容限设置（下）
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      3.4 电压与电流的容限设置（下）
      [19] 3.5 集成电路的设计规范
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      3.5 集成电路的设计规范
      [20] 3.6 片内的最大集成设计（上）
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      3.6 片内的最大集成设计（上）
      [21] 3.6 片内的最大集成设计（下）
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      [22] 3.7 信号传输延迟与功耗（上）
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      3.7 信号传输延迟与功耗（上）
      [23] 3.7 信号传输延迟与功耗（下）
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      3.7 信号传输延迟与功耗（下）
      [24] 3.8 集成块输入端口设计
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      3.8 集成块输入端口设计
      [25] 3.9 集成块输出端口设计（上）
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      3.9 集成块输出端口设计（上）
      [26] 3.9 集成块输出端口设计（下）
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      3.9 集成块输出端口设计（下）
      [27] 3.10 集成块与外部电路的匹配（...
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      [29] 4.1 开关代数的公理和定理（上）
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      4.1 开关代数的公理和定理（上）
      [30] 4.1 开关代数的公理和定理（下）
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      4.1 开关代数的公理和定理（下）
      [31] 4.2 正负逻辑、对偶关系、反演关...
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      4.2 正负逻辑、对偶关系、反演关系的应用
      [32] 4.3 逻辑函数的多种表达形式（上...
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      4.3 逻辑函数的多种表达形式（上）
      [33] 4.3 逻辑函数的多种表达形式（下...
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      4.3 逻辑函数的多种表达形式（下）
      [34] 4.4 逻辑函数的卡诺图化简方法1...
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      4.4 逻辑函数的卡诺图化简方法1（上）
      [35] 4.4 逻辑函数的卡诺图化简方法1...
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      4.4 逻辑函数的卡诺图化简方法1（下）
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      4.6 逻辑函数的卡诺图化简方法3
      [39] 4.7 定时冒险（上）
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      4.7 定时冒险（上）
      [40] 4.7 定时冒险（下）
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      4.7 定时冒险（下）
      [41] 5.1.1 FPGA及HDL简介
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      5.1.1 FPGA及HDL简介
      [42] 5.1.2 硬件描述语言HDL
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      5.1.2 硬件描述语言HDL
      [43] 5.1.3 ISE简介
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      [44] 【电子科技大学】《数字逻辑设计及应...
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      【电子科技大学】《数字逻辑设计及应用》—国家级精品课程(30)
      [45] 5.2.2 数据类型及常量、变量（...
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      [47] 5.2.3 运算符（上）
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      [49] 5.2.4.1 赋值语句和块语句
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      5.2.4.1 赋值语句和块语句
      [50] 5.2.4.2 条件语句
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      5.2.4.2 条件语句
      [51] 5.2.4.3 结构说明语句（上）
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      5.2.4.3 结构说明语句（上）
      [52] 5.2.4.3 结构说明语句（下）
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      5.2.4.3 结构说明语句（下）
      [53] 5.2.4.4 编译预处理语句
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      5.2.4.4 编译预处理语句
      [54] 5.3 组合电路设计
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      5.3 组合电路设计
      [55] 5.4 时序电路设计
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      5.4 时序电路设计
      [56] 6.1.1 组合逻辑设计文档标准1
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      6.1.2 组合逻辑设计文档标准2（上）
      [58] 6.1.2 组合逻辑设计文档标准2...
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      6.1.2 组合逻辑设计文档标准2（下）
      [59] 6.2.1 二进制译码器（上）
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      6.2.1 二进制译码器（上）
      [60] 6.2.1 二进制译码器（下）
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      6.2.1 二进制译码器（下）
      [61] 6.2.2 BCD译码器和七段显示...
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      6.2.2 BCD译码器和七段显示译码器
      [62] 6.3 编码器
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      6.3 编码器
      [63] 6.4 三态缓冲器
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      6.4 三态缓冲器
      [64] 6.5 多路复用器（上）
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      6.5 多路复用器（上）
      [65] 6.5 多路复用器（下）
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      6.5 多路复用器（下）
      [66] 6.6 多路分配器和奇偶校验电路
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      6.6 多路分配器和奇偶校验电路
      [67] 6.7.1 比较器
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      6.7.1 比较器
      [68] 6.7.2 中规模比较器
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      6.7.2 中规模比较器
      [69] 6.8 加法器
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      6.8 加法器
      [70] 7.1 时序逻辑电路概述
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      7.1 时序逻辑电路概述
      [71] 7.2 双稳态器件
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      7.2 双稳态器件
      [72] 7.3.1 SR锁存器工作原理
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      7.3.1 SR锁存器工作原理
      [73] 7.3.2 SR锁存器的描述
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      7.3.2 SR锁存器的描述
      [74] 7.4 D锁存器（上）
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      7.4 D锁存器（上）
      [75] 7.4 D锁存器（下）
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      7.4 D锁存器（下）
      [76] 7.5 D触发器
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      7.5 D触发器
      [77] 7.6 其他D触发器
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      7.6 其他D触发器
      [78] 7.7 JK触发器和T触发器
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      7.7 JK触发器和T触发器
      [79] 7.8 状态机结构
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      7.8 状态机结构
      [80] 7.9 时钟同步状态机分析1（上）
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      7.9 时钟同步状态机分析1（上）
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      [82] 7.10 时钟同步状态机分析2
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      [83] 7.11 时钟同步状态机设计1（上...
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      [84] 7.11 时钟同步状态机设计1（下...
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      [85] 7.12 时钟同步状态机设计2（上...
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      7.12 时钟同步状态机设计2（上）
      [86] 7.12 时钟同步状态机设计2（下...
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      [87] 7.13 雷鸟车尾灯（上）
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      [88] 7.13 雷鸟车尾灯（下）
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      [89] 7.14 状态机时序
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      7.14 状态机时序
      [90] 8.1 时序逻辑电路的标准文档
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      8.1 时序逻辑电路的标准文档
      [91] 8.2 集成锁存器和触发器（上）
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      8.2 集成锁存器和触发器（上）
      [92] 8.2 集成锁存器和触发器（下）
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      8.2 集成锁存器和触发器（下）
      [93] 8.3 计数器工作原理（上）
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      8.3 计数器工作原理（上）
      [94] 8.3 计数器工作原理（下）
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      [95] 8.4 二进制计数器的功能特点
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      [96] 8.5 计数模块应用1
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      [98] 8.6 计数模块应用2（下）
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      8.6 计数模块应用2（下）
      [99] 8.7 计数模块应用3
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      8.7 计数模块应用3
      [100] 8.8 移位寄存器的工作原理与应用...
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