计算机组成与CPU设计实验
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【第1集】实验：微程序控制 译
【第2集】实验：微程序控制 译
【第3集】实验：微程序控制（上） 译
【第4集】实验：微程序控制（下） 译
【第5集】实验：微程序控制 译
【第6集】课程介绍 译
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【第13集】Quartus入门视频 译
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【第27集】实验：FPGA验证流程 译
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【第30集】实验：FPGA验证流程 译
【第31集】远程实验平台教程 译
【第32集】远程实验平台教程 译
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【第36集】远程实验平台教程 译
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【第38集】Verilog：组合逻辑电路描述（上）（上） 译
【第39集】Verilog：组合逻辑电路描述（上）（下） 译
【第40集】Verilog：组合逻辑电路描述（上） 译
【第41集】Verilog：组合逻辑电路描述（上）（上） 译
【第42集】Verilog：组合逻辑电路描述（上）（下） 译
【第43集】Verilog：组合逻辑电路描述（上） 译
【第44集】实验：三态门和多路器 译
【第45集】实验：三态门和多路器 译
【第46集】Verilog：组合逻辑电路描述（下） 译
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【第48集】Verilog：组合逻辑电路描述（下）（下） 译
【第49集】Verilog：组合逻辑电路描述（下） 译
【第50集】实验：七段译码器 译
【第51集】Verilog：时序逻辑电路描述（上） 译
【第52集】Verilog：时序逻辑电路描述（上） 译
【第53集】Verilog：时序逻辑电路描述（上） 译
【第54集】Verilog：时序逻辑电路描述（上） 译
【第55集】Verilog：时序逻辑电路描述（上） 译
【第56集】实验：寄存器组（堆） 译
【第57集】实验：寄存器组（堆） 译
【第58集】实验：寄存器组（堆） 译
【第59集】Verilog：时序逻辑电路描述（中） 译
【第60集】实验：流水灯和移位寄存器 译
【第61集】Verilog：时序逻辑电路描述（下）（上） 译
【第62集】Verilog：时序逻辑电路描述（下）（下） 译
【第63集】实验：计数器与分频器 译
【第64集】Verilog：有限状态机 译
【第65集】Verilog：有限状态机（上） 译
【第66集】Verilog：有限状态机（下） 译
【第67集】Verilog：有限状态机 译
【第68集】Verilog：有限状态机 译
【第69集】实验：彩灯控制器 译
【第70集】实验：加减运算电路（上） 译
【第71集】实验：加减运算电路（下） 译
【第72集】实验：加减运算电路 译
【第73集】实验：加减运算电路（上） 译
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【第75集】实验：算术逻辑单元 译
【第76集】实验：数据通路（上） 译
【第77集】实验：数据通路（下） 译
【第78集】实验：存储器（上） 译
【第79集】实验：存储器（下） 译
【第80集】实验：存储器 译
【第81集】实验：存储器 译
【第82集】RISC-V指令系统 译
【第83集】RISC-V指令系统（上） 译
【第84集】RISC-V指令系统（下） 译
【第85集】RISC-V指令系统 译
【第86集】实验：RISC-V微架构 译
【第87集】实验：RISC-V微架构 译
【第88集】起点：只有一条addi指令的RISC-V（上） 译
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【第90集】起点：只有一条addi指令的RISC-V 译
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